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如图(a)所示为一逻辑电路。在
A
端输入信号
U
A
,在
B
端输入信号
U
B
,
U
A
和
U
B
随时间变化情况如图(b)所示,能正确表示输出端Z的输出信号
U
Z
的是图( )
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A
,在B端输入信号U
B
,U
A
和U
B
随时间变化情况如图(b)所示,能正确表示输出端Z的输出信号U
Z
的是图( )
A.
B.
C.
D.
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随时间变化情况如图(b)所示,能正确表示输出端Z的输出信号U
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随时间变化情况如图(b)所示,能正确表示输出端Z的输出信号U
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A.
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